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मैकबुक लॉजिक बोर्ड पावर रेल्स की व्याख्या:ALL_SYS_PWRGD और S3 स्थिति

Apple लॉजिक बोर्ड S3 पावर रेल निर्माण

  1. U0500 CPU/PCH SMC (सिस्टम मैनेजमेंट कंट्रोलर) को सूचित करने के लिए PM_SLP_S5_L कंट्रोल सिग्नल आउटपुट करता है कि मैकबुक पावर स्टेट ट्रांज़िशन शुरू हो जाएगा।
  2. U0500 CPU/PCH फिर PP5V_S3 पावर रेल को सक्षम करने के लिए U7501 PMIC को PM_SLP_S4_L सिग्नल आउटपुट करता है। PP5V_S3 पावर रेल पहली S3 स्टेट पावर रेल है और वोल्टेज 5V है।
<पी> मैकबुक लॉजिक बोर्ड पावर रेल्स की व्याख्या:ALL_SYS_PWRGD और S3 स्थिति

  1. PM_SLP_S4_L सिग्नल पावर रेल PP3V3_S3 को सक्षम करने के लिए रेसिस्टर R8112 को पास करता है, जिसका नाम बदलकर P3V3S3_EN कर दिया गया है। PP3V3_S3 पावर रेल का वोल्टेज 3.3V है।
  2. PM_SLP_S4_L सिग्नल रेसिस्टर R8116 से गुजरता है, जिसे पावर रेल PP1V8_S3 बनाने के लिए P1V8S3_EN नाम दिया गया है। PP1V8_S3 पावर रेल का वोल्टेज 1.8V है।
  3. PM_SLP_S4_L सिग्नल 20k-ओम रेसिस्टर R8116 से गुजरता है, जिसे PP1V2_S3 पावर रेल बनाने के लिए DDRREG_EN नाम दिया गया है। PP1V2_S3 पावर रेल का उपयोग DDR3 मेमोरी चिप्स को पावर देने के लिए किया जाता है, वोल्टेज 1.2V है।
  4. PM_SLP_S4_L सिग्नल 100-ओम अवरोधक R8117 से गुजरता है, जिसे USB पोर्ट पावर VBUS को सक्षम करने के लिए USB_PWR_EN नाम दिया गया है। USB पोर्ट पावर रेल VBUS वोल्टेज 5V है।
  5. PM_SLP_S4_L नियंत्रण सिग्नल का उपयोग टचपैड और ब्लूटूथ डिवाइस को सक्षम करने के लिए भी किया जाता है।
<पी> नोट:ये S3 पावर रेल एक ही समय में नहीं बनाई गई हैं। आरसी विलंब सर्किट का उपयोग विलंब समय, इसलिए समय को नियंत्रित करने के लिए किया जाता है। प्रतिरोधों और कैपेसिटर के मूल्यों को बदलकर, हम अपनी इच्छानुसार विलंब समय प्राप्त कर सकते हैं।

Apple लॉजिक बोर्ड S0 पावर रेल निर्माण

  1. U0500 CPU/PCH तब मैक लॉजिक बोर्ड पावर स्थिति को S3 से S0 स्थिति (पावर ऑन) में बदलने के लिए PM_SLP_S3_L सिग्नल आउटपुट करता है।
  2. PP5V_S0 पावर रेल बनाने के लिए PM_SLP_S3_L नियंत्रण सिग्नल अवरोधक R8187 को पास करता है, जिसका नाम बदलकर P5VS0_EN कर दिया गया है। PP5V_S0 पावर रेल का वोल्टेज 5V है।
  3. PP3V3_S0 पावर रेल बनाने के लिए PM_SLP_S3_L नियंत्रण सिग्नल 20k-ओम अवरोधक R8186 से गुजरता है, जिसे P3V3S0_EN नाम दिया गया है। PP3V3_S0 पावर रेल का वोल्टेज 3.3V है।
  4. PP1V05_S0 पावर रेल बनाने के लिए PM_SLP_S3_L नियंत्रण सिग्नल अवरोधक R8185 को पास करता है, जिसका नाम बदलकर P1V05S0_EN कर दिया गया है। PP1V05_S0 पावर रेल का वोल्टेज 1.05V है। इस पावर रेल का उपयोग Intel CPU/PCH और इसकी सिस्टम बसों द्वारा किया जाता है।
  5. PM_SLP_S3_L नियंत्रण सिग्नल AND-लॉजिक गेट U8180 से गुजरता है, जिसका नाम बदलकर PM_SLP_S3_BUF_L कर दिया गया है। AND_logic गेट का उपयोग PM_SLP_S3_L नियंत्रण सिग्नल की शक्ति बढ़ाने के लिए किया जाता है। PM_SLP_S3_BUF_L नियंत्रण सिग्नल का वोल्टेज 3.3V है।
<पी> मैकबुक लॉजिक बोर्ड पावर रेल्स की व्याख्या:ALL_SYS_PWRGD और S3 स्थिति

  1. PM_SLP_S3_BUF_L नियंत्रण सिग्नल U7870 स्विच पर जाता है जिससे PP1V5_S0 पावर रेल बनती है। PP1V5_S0 पावर रेल का वोल्टेज 1.5V है।
  2. 3.3V PM_SLP_S3_BUF_L नियंत्रण सिग्नल का उपयोग 10K-ओम अवरोधक R8167 के माध्यम से ALL_SYS_PWRGD नियंत्रण सिग्नल को पोल करने के लिए पावर रेल के रूप में भी किया जाता है। यही कारण है कि हमें PM_SLP_S3_L के कमजोर संस्करण के बजाय PM_SLP_S3_BUF_L के पावरफोल संस्करण की आवश्यकता है।
<पी> नोट:ये S0 पावर रेल एक ही समय में नहीं बनाई गई हैं। समय PM_SLP_S3_L नियंत्रण सिग्नल और संबंधित RC विलंब सर्किट द्वारा निर्धारित किया जाता है।

ALL_SYS_PWRGD सिग्नल का महत्व

<पी> Apple ने यह सुनिश्चित करने के लिए एक जटिल सत्यापन तंत्र विकसित किया है कि बनाई जा रही सभी पावर रेलें उपयोग के लिए स्थिर और अच्छी हैं (जीडी का मतलब अच्छा है)। यदि सभी पावर रेल अच्छी हैं, तो एक वैध ALL_SYS_PWRGD सिग्नल उत्पन्न होगा। ALL_SYS_PWRGD वोल्टेज 3.3V है।

<पी> एक वैध ALL_SYS_PWRGD सिग्नल इन पावर रेल्स की जाँच करता है:PP1V8_S3, PP5V_S3, PP1V2_S3, PP1V05_S0, PP5V_S0, PP3V3_S0, PP1V5_S0। इनमें से कोई भी S3 या S0 राज्य पावर रेल की खराबी ALL_SYS_PWRGD सिग्नल को ख़राब कर देगी और Apple कंप्यूटर की सामान्य पावर-ऑन प्रक्रिया को समाप्त कर देगी।

<पी> मैकबुक लॉजिक बोर्ड पावर रेल्स की व्याख्या:ALL_SYS_PWRGD और S3 स्थिति

<पी> ALL_SYS_PWRGD सिग्नल की सूचना एसएमसी को दी जाएगी। एसएमसी इस सिग्नल को संसाधित करेगी और अंतिम पावर रेल - सीपीयू/पीसीएच वीकोर पावर रेल बनाने की तैयारी करेगी।
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